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CPU
MIPS

MIPS R10000

Processore

Core CPU
1*

Non sono ancora disponibili benchmark associati a questa scheda.

Elaborazione e piattaforma

Core CPU
1*
Thread hardware per core
1*

Configurazione di sistema

Specifiche dettagliate

Specifiche · 77 campi
ifu Microarchitettura CPU
2*
metal layers Processo produttivo
4*
lsfu Microarchitettura CPU
1*
fpfu Microarchitettura CPU
3*
date
1996-01-01*
date
1996-01-01*
date
1996-01-01*
date
1996-01-01*
date
1996-01-01*
tfu Microarchitettura CPU
6*
vdd nom Processo produttivo
3,3*
clock
250*
clock
195*
clock
180*
clock
200*
clock
196*
max inst decoded Microarchitettura CPU
4*
rob size Microarchitettura CPU
32*
hw nthreadspercore
1*
hw nthreadspercore
1*
hw nthreadspercore
1*
hw nthreadspercore
1*
hw nthreadspercore
1*
iwindow Microarchitettura CPU
5*
hw ncores
1*
hw ncores
1*
hw ncores
1*
hw ncores
1*
hw ncores
1*
bht size Microarchitettura CPU
512*
btb size Microarchitettura CPU
512*
bus width
64*
bus width
64*
bus width
64*
bus width
64*
bus width
64*
arch int reg Microarchitettura CPU
32*
transistors
6,8*
transistors
6,8*
transistors
6,8*
transistors
6,8*
transistors
6,8*
arch fp reg Microarchitettura CPU
32*
die size
298*
die size
298*
die size
298*
die size
298*
die size
298*
total arch reg Microarchitettura CPU
64*
vdd low
3,3*
vdd low
3,3*
vdd low
3,3*
vdd low
3,3*
vdd low
3,3*
vdd high
3,3*
vdd high
3,3*
vdd high
3,3*
vdd high
3,3*
vdd high
3,3*
out of order Microarchitettura CPU
t*
memory bw Microarchitettura CPU
3.200*
integrated mc Microarchitettura CPU
f*
l1i Configurazione cache CPU
32*
name Nome in codice del processore
T5*
name Famiglia del processore
R10000*
name Microarchitettura CPU
R10000*
l1d Configurazione cache CPU
32*
l2 shared Configurazione cache CPU
1.024*
l2 shared Configurazione cache CPU
4.096*
l2 shared Configurazione cache CPU
2.048*
year Processo produttivo
1995*
fp pipestages Microarchitettura CPU
7*
technology Processo produttivo
CMOS*
feature size Processo produttivo
0,35*
int pipestages Microarchitettura CPU
5*
channel length Processo produttivo
0,35*
max uop issued per cycle Microarchitettura CPU
5*

* Dati provvisori